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数字IP设计工程师7175

Unisoc (Shanghai) Technologies Co., Ltd.

杭州市RTL / HDLPhysical designFPGAPosted Mar 30, 2023
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  • Verilog
  • PCIe
  • AMBA / AXI
  • USB
1、完成模块从算法/协议到架构的实现； 2、完成模块的RTL实现及相关验证工作； 3、完成模块的PPA（Performance，Power，Area）优化； 4、参与算法/协议/架构的评估与优化； 5、参与模块的FPGA验证及芯片调试； 6、参与技术方向的规划和解决方案的评估。 1、电子/信息相关专业，硕士及以上学历，3年及以上工作经历； 2、精通verilog RTL描述语言； 3、熟悉数字电路设计和验证方法学； 4、熟悉EDA工具和脚本语言； 5、熟悉MIPI/USB/DDR/PCIE/UFS等高速接口； 6、熟悉AMBA总线协议(AXI/APB/AHB)； 7、对多媒体或高速接口有一定的设计经验； 8、对低功耗设计有一定的了解； 9、对计算机体系结构有一定的了解； 10、正直诚信、有责任心、有团队合作精神。

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RISC-V ecosystem

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RISC-V International: Strategic

Unisoc, formerly Spreadtrum Communications, Inc., Unisoc has research centres in Shanghai, Beijing, Tianjin, Suzhou, Hangzhou, Chengdu, Xiamen, United States, Finland and India, technical support…

  • Unisoc (Shanghai) is a large Chinese mobile/IoT chipset vendor listed as a RISC-V member
  • Appears in RISC-V ecosystem coverage including a RISC-V ISA based DSP heading to mass production and RISC-V blockchain SIG activity

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